Расчет устройства записи, хранения и передачи чисел
Курсовой проект - Компьютеры, программирование
Другие курсовые по предмету Компьютеры, программирование
? схеме присутствуют 2 шифратора (DD1,DD2). Выходы у данных дешифраторов инверсные, поэтому при объединении их выходов были применены логические элементы И с инверсными выходами, что дало возможность получить прямой код вводимого числа. Данный шифратор позволяет получить трех разрядный двоичный код числа. Четвертый разряд взят с вывода Р шифратора. Данный вывод запрещает работу предыдущему шифратору DD1, когда активен шифратор DD2. При запрете не нем формируется логическая единица. Логический элемент И DD7.1 формирует логическую единицу при нажатии любой кнопки. После включения устройства все выходы счетчика DD10.1 установлены в 0. На адресные входы RAM подается код первой строки ячеек памяти. При нажатии на одну из кнопок в блоке ввода, ее десятичный код преобразуется в двоичный и поступает на информационные входы D1-D4 RAM. Из элемента DD7.1, через логический элемент DD8.1, на инверторы DD6.2 и DD4.5 поступает напряжение высокого уровня, затем оно инвертируется в напряжение низкого уровня, разрешая тем самым запись кода в RAM. При отпускании кнопки блока ввода напряжение на счетном входе счетчика DD10.1 переходит из высокого уровня и низкий, и счетчик инкрементируется на единицу. На адресные входы A1-A4 поступает код второй строки матрицы памяти RAM. И далее операции повторяются, после нажатия на кнопку блока ввода, на информационные входы RAM подается код числа. Разрешается запись числа в RAM, и при отпускании кнопки счетчик DD10.1 инкрементируется на единицу. После ввода последнего, шестнадцатого числа, счетчик DD10.1 установится в ноль, на выходе логического элемента DD7.2 сформируется положительный перепад напряжения. Счетчик DD10.2, который производит счет по положительному перепаду напряжения, инкрементируется на единицу и запрещает запись чисел в RAM. Далее разрешается запись регистру DD17.2, на вход разрешения записи РЕ подается напряжение низкого уровня. При нажатии на кнопку блока ввода на информационные входы регистра DD17.2 подается код числа, с которым будет сравниваться старший разряд хранящихся в RAM чисел, и записывается в него. При отпускании кнопки триггер DD3 переключается и запрещает работу шифраторам. При дальнейших нажатиях на кнопки на выходе шифраторов не будут генерироваться коды. При переключении триггера DD3 на вход логического элемента И DD8.2 подается напряжение высокого уровня, и разрешается подача синхро-импульсов на счетчик DD9. Устройство переходит ко второй фазе работы, считыванию чисел из RAM, сравнению старшего разряда чисел с введенным числом пользователем, и при их совпадении, передаче числа. На элементах DD9, DD12, DD14, DD11.3, DD11.4 собрана комбинационная схема, которая генерирует последовательность сигналов требуемых для чтения из RAM, записи в регистры DD16.1, DD17.1, DD19. и передачи чисел.
Перед началом считывания числа из RAM счетчик DD10.1 сформировал код адреса первой строки матрицы памяти. На входы РВ и РЗ подается комбинация кодов разрешающая чтение из RAM (см. описание RAM), через логические элементы DD6.2, DD4.5. На выходе RAM формируется инверсный код старшего разряда первого числа и записывается в буферный регистр DD16.1. Так как на выходе RAM формируется инверсный код числа записанного в запоминающих элементах, к выходу буферного регистра DD16.1 подключены инверторы для получения прямого кода числа. Далее регистрам DD17.1 и DD19.1 разрешается запись, и в них записывается старший разряд числа. После этого подается импульс на счетный вход счетчика DD10.1 на его выходе формируется код второй строки матрицы RAM. На входы РВ и РЗ подается комбинация кодов разрешающая чтение из RAM, инверсный код младшего разряда числа записывается в регистр и на инверторах преобразуется в прямой код числа. Разрешается запись регистру DD19.2 и младший разряд числа в него записывается. Если сравниваемые числа компаратором DD18 равны, на соответствующем выходе формируется напряжение высокого уровня и подается на вход логического элемента DD15.1. На второй вход данного элемента подается сигнал разрешения передачи от дешифратора DD12 через инвертор DD14.6, и число передается на выход. В случае если от дешифратора DD12 подался сигнал разрешения передачи, а от компаратора DD18 нет, то число не передается. Далее на счетчик DD10.1 подается импульс, счетчик инкрементируется и цикл повторяется. После того как было сравнено последнее число, на счетчик DD10.1 подается импульс, счетчик переходит в ноль. На выходе элемента И DD7.2 формируется напряжение положительного перепада. Счетчик DD10.2 инкрементируется, на выходе формируется код 0010, единичка через инвертор DD20.1 инвертируется, счетчик DD10 сбрасываются. Через инвертор DD4.4 сбрасывается триггер. Запрещается подача импульсов счетчику DD9. Разрешается работа шифраторам и устройство готово к следующему циклу ввода чисел.
Заключение
В курсовом проекте было разработано устройство хранения и передачи чисел, которое было разработано по индивидуальному заданию и удовлетворяющее его требованиям. Были применены все теоретические и практические навыки, использованы различные схемотехнические приемы для разработки заданного устройства.